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AXI实战(一)-为AXI总线搭建简单的仿真测试环境

AXI实战(一)-搭建简单仿真环境

看完在本文后,你将可能拥有:

  1. 一个可以仿真AXI/AXI_Lite总线的完美主端(Master)或从端(Slave)
  2. 一个使用SystemVerilog仿真模块的船信体验

小何的AXI实战系列开更了,以下是初定的大纲安排:

axi_flow

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文章目录

  • AXI实战(一)-搭建简单仿真环境
    • @[toc]
    • 写在前面
    • Driver
    • Axi-Lite Driver通道实现和顶层master使用
      • 写事务
      • 给定地址写特定数据write
      • 读事务
      • 给定地址读特定数据read
      • run!
    • 如何使用

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