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使用Platform Designer创建Nios II 最小系统

news 2026/2/10 18:21:26

Nios II简介

Nios II 软核处理器十多年前就有了，它和xilinx的MicroBlaze类似，性能相比硬核处理器要差得多，工程应用也不是很多，那还有必须学习一下吗？我个人认为了解一下Nios II开发流程，对intel FPGA开发有好处，因为很多quartus的IP实例工程都使用Platform Designer设计的模块工程，如果不懂怎么使用Platform Designer示例工程用起来不会那么得心应手。

Niso II最小系统组成

使用Platform Designer创建Nios II最小系统主要包括一下4个部分：

Nios II处理器
onchip_memory片上存储
System ID组件
JTAG UART组件

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构建最小系统

打开Platform Designer

点击Tools->Platform Designer

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打开后出现如下对话框，点击红圈中的按钮创建qsys文件

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创建qsys文件

输入qsys文件名称，然后点击create。

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时钟与复位

生产qsys文件后，会自动生成时钟与复位，in_clk为时钟输入，in_reset为复位输入。

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设置输入时钟频率

双击clock_in模块，设置输入时钟为100Mhz。

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设置复位电平

设置复位为低电平复位。

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添加Nios II

在IP Catalog中搜索Nios II，双击Nios II Processor。

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在出现的对话框中设置Nios II处理器，选择默认设置，将模块名字修改成nios2。

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-yjH04pJf-1677409397556)(./pic/9.png)]

添加onchip_memory

将Total memory size改成12800。

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-3uoikuDx-1677409397557)(./pic/10.png)]

添加sysid

将ID设置成0x00000023。

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-CpbixMCW-1677409397557)(./pic/11.png)]

添加JTAG UART

选择默认设置。

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-XIbAj23A-1677409397557)(./pic/12.png)]

连接信号

按下图所示，连接信号

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Nios II处理器复位向量与异常向量地址设置

设置名称与onchip_memory模块名称关联。

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-LnOotLri-1677409397558)(./pic/15.png)]

生成HDL

点击右下角的Validate System Integrity验证系统连接是否正常，点击Generate HDL生成HDL。

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-wbEAJvZB-1677409397558)(./pic/14.png)]

sopcinfo文件

完成上述步骤后Nios II最小系统创建完成，生成sopcinfo文件，该文件在软件开发中使用。

使用Platform Designer创建Nios II 最小系统

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