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[AG32VF407]国产MCU+FPGA Verilog编写控制2路gpio输出不同频率方波实验

视频讲解

[AG32VF407]国产MCU+FPGA Verilog编写控制2路gpio输出不同频率方波实验

实验过程

根据原理图,选择两个pin脚作为输出
在这里插入图片描述
修改VE文件,clk选择PIN_OSC,使用内部晶振8Mhz,gpio使用PIN_51和52,pinout是数组在这里插入图片描述
添加pll,修改pll,输入频率8M在这里插入图片描述输出c0,32Mhz在这里插入图片描述
输出c1,8Mhz在这里插入图片描述
增加verilog逻辑代码,两个always循环,按照c0和c1翻转pin_51和pin_52

`timescale 1ns / 1nsmodule test(clk,pinout);input    clk;
output [2:0] pinout;
reg [2:0]  pinout;pll    pll1_inst (.areset ( 1'b0 ),.inclk0 ( clk ),.c0 ( c0 ),.c1 ( c1 ));wire c0;
wire c1;initial begin
pinout = 3'b111;
endalways@(posedge c0) beginpinout[0] = ~pinout[0];
endalways@(posedge c1) beginpinout[1] = ~pinout[1];
endendmodule

烧录,选择full chip erase before program
在这里插入图片描述
实测波形,这里12Mx2=24M,还有3.2Mx2=6.4M,和实际设置有差异,不确定是内部晶振问题还是配置问题,还需要和AGM进行技术咨询,总体的逻辑是符合预期,调整clock out的比例,波形输出也成比例。
在这里插入图片描述

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