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【从零开始学习 UVM】11.4、UVM Register Layer —— UVM Register Model 实战项目（RAL实战，交通灯为例）

news 2025/9/18 17:57:31

文章目录

    • Design
    • Interface
    • Register Model Example
    • Register Environment
    • APB Agent Example
    • Testbench Environment
    • Sequences
    • Test

在之前的几篇文章中，我们已经了解了寄存器模型是什么以及如何使用它来访问给定设计中的寄存器。现在让我们看一个完整的例子，展示如何为给定设计编写这样的模型，如何将其集成到环境中，并且如何使用它来读写设计字段。

Design

以下设计具有通过APB接口可访问的以下寄存器和字段。该设计本质上代表了一个交通信号灯控制器，可以通过写入某些控制寄存器进行配置。

ctl寄存器包含启动模块和配置为闪烁黄色或闪烁红色模式的字段。状态寄存器是只读的，返回设计当前状态 - 黄色、红色或绿色。两个timer寄存器存储从每个状态转换所需的时间。<

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